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Débito em baud da UART

Valor UBRR / divisor, débito em baud real e erro de relógio a partir do relógio do MCU e do baud pretendido. Mantenha-se abaixo de 2% de erro para uma UART assíncrona fiável.

Cadeia de divisores de relógio tempo de bit — µs

Relógio do MCU Hz

Baud pretendido bps

Sobreamostragem

Offset do registo

Notas de engenharia

Fórmula

UBRR = fclk / (OSR × baud) − offset
actual = fclk / (OSR × (UBRR + offset))
error = (actual − target) / target × 100

Metas de erro

<0,5%: muito estável mesmo ao longo da temperatura.
0,5–2%: aceitável para tramas curtas à temperatura ambiente.
>2%: erros de enquadramento são prováveis — escolha outro relógio ou use um divisor de baud fracionário.
Relógios baseados em cristal superam o RC interno em fiabilidade série.

Resultado

Em direto