Apenas em computador

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Orçamento de velocidade I²C / SPI

Débito efetivo face à taxa de amostragem pretendida. Considera a sobrecarga, os bits ACK, o start/stop e a seleção de registo.

Disposição da transação I²C 400 kHz

Barramento

Carga útil bytes/transação

Taxa de atualização Hz

Dispositivos no barramento

Notas de engenharia

9 bits por byte (8 de dados + 1 ACK).
Start + endereço + seleção de registo + restart + endereço repetido ≈ ~30 bits por transação.
A velocidade de barramento indicada é o período do SCL — a taxa de dados real é inferior a 80% disso.
Clock stretching: a slave may hold SCL low after any byte, inflating real transaction time.

Sem bits ACK — a sobrecarga é apenas a comutação do CS (~1 tempo de byte).
Full-duplex; débito útil = bytes por transferência × frequência / 8.
Em SPI baseado em DMA, o CPU fica livre durante a transferência — verifique se o seu periférico permite encadeamento.

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