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Presupuesto de velocidad I²C / SPI

Rendimiento efectivo frente a la tasa de muestreo objetivo. Tiene en cuenta la sobrecarga, los bits ACK, el start/stop y la selección de registro.

Disposición de la transacción I²C 400 kHz

Bus

Carga útil bytes/transacción

Tasa de actualización Hz

Dispositivos en el bus

Notas de ingeniería

9 bits por byte (8 de datos + 1 ACK).
Start + dirección + selección de registro + restart + dirección repetida ≈ ~30 bits por transacción.
La velocidad de bus indicada es el periodo de SCL: la tasa de datos real es <80% de ese valor.
Clock stretching: a slave may hold SCL low after any byte, inflating real transaction time.

Sin bits ACK: la sobrecarga es solo el cambio de CS (~1 tiempo de byte).
Full-duplex; rendimiento útil = bytes por transferencia × frecuencia / 8.
Con SPI por DMA, la CPU queda libre durante la transferencia: comprueba si tu periférico encadena.

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