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I²C / SPI Geschwindigkeitsbudget

Effektiver Durchsatz vs. Ziel-Abtastrate. Berücksichtigt Overhead, ACK-Bits, Start/Stopp, Registerauswahl.

Transaktionslayout I²C 400 kHz

Bus

Nutzlast Bytes/Transaktion

Aktualisierungsrate Hz

Geräte am Bus

Engineering-Notizen

9 Bit pro Byte (8 Daten + 1 ACK).
Start + Adresse + Register-Auswahl + Restart + wiederholte Adresse ≈ ~30 Bit pro Transaktion.
Die angegebene Busgeschwindigkeit ist die SCL-Periode — die tatsächliche Datenrate liegt bei <80% davon.
Clock stretching: a slave may hold SCL low after any byte, inflating real transaction time.

Keine ACK-Bits — der Overhead ist nur das CS-Toggle (~1 Byte-Zeit).
Vollduplex; nutzbarer Durchsatz = Bytes pro Transfer × Frequenz / 8.
Bei DMA-basiertem SPI ist die CPU während des Transfers frei — prüfen Sie, ob Ihre Peripherie verkettet.

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